SDRAM Alliance Memory, 512 Mo Surface 8 bit 95 °C 0 °C 78 broches, FBGA-78 billes
- Code commande RS:
- 425-142
- Référence fabricant:
- AS4C64M8D3-12BCN
- Marque:
- Alliance Memory
Sous-total (1 plateau de 242 unités)*
1 300,992 €
HT
1 561,142 €
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Unité | Prix par unité | le plateau* |
|---|---|---|
| 242 + | 5,376 € | 1 300,99 € |
*Prix donné à titre indicatif
- Code commande RS:
- 425-142
- Référence fabricant:
- AS4C64M8D3-12BCN
- Marque:
- Alliance Memory
Caractéristiques techniques
Documentation technique
Législation et Conformité
Détail produit
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Sélectionner tout | Attribut | Valeur |
|---|---|---|
| Marque | Alliance Memory | |
| Type de produit | SDRAM | |
| Taille de la mémoire | 512Mo | |
| Largeur de bus de données | 8bit | |
| Nombre de bits par mot | 8 | |
| Fréquence d'horloge maximum | 800MHz | |
| Temps d'accès aléatoire maximum | 20ns | |
| Type de montage | Surface | |
| Type de Boitier | FBGA-78 billes | |
| Température minimum de fonctionnement | 0°C | |
| Nombre de broches | 78 | |
| Température d'utilisation maximum | 95°C | |
| Longueur | 10.5mm | |
| Hauteur | 1mm | |
| Série | AS4C64M8D3 | |
| Normes/homologations | RoHS, JEDEC Standard | |
| Tension d'alimentation minimum | 1.425V | |
| Tension d'alimentation maximum | 1.5V | |
| Standard automobile | Non | |
| Sélectionner tout | ||
|---|---|---|
Marque Alliance Memory | ||
Type de produit SDRAM | ||
Taille de la mémoire 512Mo | ||
Largeur de bus de données 8bit | ||
Nombre de bits par mot 8 | ||
Fréquence d'horloge maximum 800MHz | ||
Temps d'accès aléatoire maximum 20ns | ||
Type de montage Surface | ||
Type de Boitier FBGA-78 billes | ||
Température minimum de fonctionnement 0°C | ||
Nombre de broches 78 | ||
Température d'utilisation maximum 95°C | ||
Longueur 10.5mm | ||
Hauteur 1mm | ||
Série AS4C64M8D3 | ||
Normes/homologations RoHS, JEDEC Standard | ||
Tension d'alimentation minimum 1.425V | ||
Tension d'alimentation maximum 1.5V | ||
Standard automobile Non | ||
- Pays d'origine :
- TW
Les DRAM Alliance Memory 512 Mo Double-Data-Rate-3L (DDR3L) sont dotées d'une architecture à double débit de données afin d'assurer un fonctionnement à haut débit. La puce est conçue pour se conformer à toutes les caractéristiques clés de la DRAM DDR3L, et toutes les entrées de contrôle et d'adresse sont synchronisées avec une paire d'horloges différentielles fournies en externe.
Ajustement de l'écriture
Étalonnage ZQ
ODT dynamique (Rtt_Nom et Rtt_WR)
Conforme RoHS
Actualisation automatique et auto-actualisation
Conformité à la norme JEDEC