SDRAM Alliance Memory, 8 GB Surface 16 bit 95 °C 0 °C 96 broches, FBGA-96 billes
- Code commande RS:
- 425-186
- Référence fabricant:
- AS4C512M16D3L-12BCN
- Marque:
- Alliance Memory
Indisponible
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- Code commande RS:
- 425-186
- Référence fabricant:
- AS4C512M16D3L-12BCN
- Marque:
- Alliance Memory
Caractéristiques techniques
Documentation technique
Législation et Conformité
Détail produit
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Sélectionner tout | Attribut | Valeur |
|---|---|---|
| Marque | Alliance Memory | |
| Taille de la mémoire | 8GB | |
| Type de produit | SDRAM | |
| Configuration | 512M x 16 | |
| Largeur de bus de données | 16bit | |
| Nombre de bits par mot | 16 | |
| Fréquence d'horloge maximum | 800MHz | |
| Temps d'accès aléatoire maximum | 15ns | |
| Type de montage | Surface | |
| Type de Boitier | FBGA-96 billes | |
| Température minimum de fonctionnement | 0°C | |
| Nombre de broches | 96 | |
| Température d'utilisation maximum | 95°C | |
| Hauteur | 1.1mm | |
| Largeur | 9 mm | |
| Longueur | 14mm | |
| Normes/homologations | RoHS | |
| Série | AS4C512M16D3L | |
| Tension d'alimentation minimum | 1.283V | |
| Standard automobile | Non | |
| Tension d'alimentation maximum | 1.35V | |
| Sélectionner tout | ||
|---|---|---|
Marque Alliance Memory | ||
Taille de la mémoire 8GB | ||
Type de produit SDRAM | ||
Configuration 512M x 16 | ||
Largeur de bus de données 16bit | ||
Nombre de bits par mot 16 | ||
Fréquence d'horloge maximum 800MHz | ||
Temps d'accès aléatoire maximum 15ns | ||
Type de montage Surface | ||
Type de Boitier FBGA-96 billes | ||
Température minimum de fonctionnement 0°C | ||
Nombre de broches 96 | ||
Température d'utilisation maximum 95°C | ||
Hauteur 1.1mm | ||
Largeur 9 mm | ||
Longueur 14mm | ||
Normes/homologations RoHS | ||
Série AS4C512M16D3L | ||
Tension d'alimentation minimum 1.283V | ||
Standard automobile Non | ||
Tension d'alimentation maximum 1.35V | ||
- Pays d'origine :
- SG
Les DRAM Alliance Memory 8 Go Double-Data-Rate-3 (DDR3L) sont dotées d'une architecture à double débit de données afin d'assurer un fonctionnement à haut débit. La puce est conçue pour se conformer à toutes les caractéristiques clés de la DRAM DDR3L, et toutes les entrées de contrôle et d'adresse sont synchronisées avec une paire d'horloges différentielles fournies en externe.
Ajustement de l'écriture
Étalonnage ZQ
Conforme RoHS
Actualisation automatique et auto-actualisation