SDRAM Alliance Memory, 8 GB Surface 16 bit 85 °C 30 °C 96 broches, FBGA-96 billes
- Code commande RS:
- 425-298
- Référence fabricant:
- AS4C512M16D3LB-12BINTR
- Marque:
- Alliance Memory
Sous-total (1 bobine de 2000 unités)*
108 152,00 €
HT
129 782,00 €
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Unité | Prix par unité | la bobine* |
|---|---|---|
| 2000 + | 54,076 € | 108 152,00 € |
*Prix donné à titre indicatif
- Code commande RS:
- 425-298
- Référence fabricant:
- AS4C512M16D3LB-12BINTR
- Marque:
- Alliance Memory
Caractéristiques techniques
Documentation technique
Législation et Conformité
Détail produit
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Sélectionner tout | Attribut | Valeur |
|---|---|---|
| Marque | Alliance Memory | |
| Type de produit | SDRAM | |
| Taille de la mémoire | 8Go | |
| Largeur de bus de données | 16bit | |
| Nombre de bits par mot | 16 | |
| Fréquence d'horloge maximum | 2133MHz | |
| Temps d'accès aléatoire maximum | 20ns | |
| Type de montage | Surface | |
| Type de Boitier | FBGA-96 billes | |
| Température minimum de fonctionnement | 30°C | |
| Nombre de broches | 96 | |
| Température d'utilisation maximum | 85°C | |
| Longueur | 13.5mm | |
| Série | AS4C512M16D3LB | |
| Normes/homologations | RoHS, JEDEC Standard | |
| Standard automobile | Non | |
| Tension d'alimentation minimum | 0.6V | |
| Tension d'alimentation maximum | 1.35V | |
| Sélectionner tout | ||
|---|---|---|
Marque Alliance Memory | ||
Type de produit SDRAM | ||
Taille de la mémoire 8Go | ||
Largeur de bus de données 16bit | ||
Nombre de bits par mot 16 | ||
Fréquence d'horloge maximum 2133MHz | ||
Temps d'accès aléatoire maximum 20ns | ||
Type de montage Surface | ||
Type de Boitier FBGA-96 billes | ||
Température minimum de fonctionnement 30°C | ||
Nombre de broches 96 | ||
Température d'utilisation maximum 85°C | ||
Longueur 13.5mm | ||
Série AS4C512M16D3LB | ||
Normes/homologations RoHS, JEDEC Standard | ||
Standard automobile Non | ||
Tension d'alimentation minimum 0.6V | ||
Tension d'alimentation maximum 1.35V | ||
- Pays d'origine :
- TW
Les DRAM Alliance Memory 8 Go Double-Data-Rate-3 (DDR3L) sont dotées d'une architecture à double débit de données afin d'assurer un fonctionnement à haut débit. La puce est conçue pour se conformer à toutes les caractéristiques clés de la DRAM DDR3L, et toutes les entrées de contrôle et d'adresse sont synchronisées avec une paire d'horloges différentielles fournies en externe.
Ajustement de l'écriture
Étalonnage ZQ
Conforme RoHS
Actualisation automatique et auto-actualisation