SDRAM Alliance Memory, 128 Mo En surface 16 bit 85 °C -40 °C 54 broches, TSOP
- Code commande RS:
- 230-8438
- Référence fabricant:
- AS4C8M16SA-6TIN
- Marque:
- Alliance Memory
Actuellement indisponible
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- Code commande RS:
- 230-8438
- Référence fabricant:
- AS4C8M16SA-6TIN
- Marque:
- Alliance Memory
Caractéristiques techniques
Documentation technique
Législation et Conformité
Détail produit
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Sélectionner tout | Attribut | Valeur |
|---|---|---|
| Marque | Alliance Memory | |
| Taille de la mémoire | 128Mo | |
| Type de produit | SDRAM | |
| Configuration | 8 Mb x 16 bits | |
| Largeur de bus de données | 16bit | |
| Largeur de bus d'adresse | 12bit | |
| Nombre de bits par mot | 16 | |
| Fréquence d'horloge maximum | 166MHz | |
| Temps d'accès aléatoire maximum | 5ns | |
| Nombre de mots | 2M | |
| Type de montage | En surface | |
| Type de Boitier | TSOP | |
| Température minimum de fonctionnemen | -40°C | |
| Nombre de broches | 54 | |
| Température d'utilisation maximum | 85°C | |
| Hauteur | 1.2mm | |
| Normes/homologations | No | |
| Largeur | 8.1mm | |
| Série | AS4C8M16SA | |
| Longueur | 22.35mm | |
| Tension d'alimentation minimum | 3V | |
| Standard automobile | Non | |
| Tension d'alimentation maximum | 3.6V | |
| Sélectionner tout | ||
|---|---|---|
Marque Alliance Memory | ||
Taille de la mémoire 128Mo | ||
Type de produit SDRAM | ||
Configuration 8 Mb x 16 bits | ||
Largeur de bus de données 16bit | ||
Largeur de bus d'adresse 12bit | ||
Nombre de bits par mot 16 | ||
Fréquence d'horloge maximum 166MHz | ||
Temps d'accès aléatoire maximum 5ns | ||
Nombre de mots 2M | ||
Type de montage En surface | ||
Type de Boitier TSOP | ||
Température minimum de fonctionnemen -40°C | ||
Nombre de broches 54 | ||
Température d'utilisation maximum 85°C | ||
Hauteur 1.2mm | ||
Normes/homologations No | ||
Largeur 8.1mm | ||
Série AS4C8M16SA | ||
Longueur 22.35mm | ||
Tension d'alimentation minimum 3V | ||
Standard automobile Non | ||
Tension d'alimentation maximum 3.6V | ||
La mémoire SDRAM Alliance Memory 128 Mo est une DRAM synchrone CMOS haut débit contenant 128 Mbits. Il est configuré en interne sous la forme de 4 blocs de 2 m de DRAM x 16 avec une interface synchrone (tous les signaux sont enregistrés sur le bord positif du signal d'horloge, CLK). Les accès en lecture et en écriture à la SDRAM sont orientés vers la rafale; Accès au démarrage à un emplacement sélectionné et poursuite pour un nombre programmé d'emplacements dans une séquence programmée. Les accès commencent par l'enregistrement d'une commande BankActivate qui est ensuite suivie d'une commande de lecture ou d'écriture.
Actualisation automatique et actualisation automatique
4 096 cycles de rafraîchissement/64 ms
Mode de mise hors tension CKE
Alimentation unique +3,3 V à 0,3 V.
Interface : LVTTL