FPGA Lattice Semiconductor iCE40 3520 Cellules, 80000 bit 440 Blocs, 144 broches TQFP
- Code commande RS:
- 168-4222
- Référence fabricant:
- ICE40HX4K-TQ144
- Marque:
- Lattice Semiconductor
Sous-total (1 plateau de 60 unités)*
536,40 €
HT
643,80 €
TTC
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Unité | Prix par unité | le plateau* |
|---|---|---|
| 60 + | 8,94 € | 536,40 € |
*Prix donné à titre indicatif
- Code commande RS:
- 168-4222
- Référence fabricant:
- ICE40HX4K-TQ144
- Marque:
- Lattice Semiconductor
Caractéristiques techniques
Documentation technique
Législation et Conformité
Détail produit
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Sélectionner tout | Attribut | Valeur |
|---|---|---|
| Marque | Lattice Semiconductor | |
| Série | iCE40 | |
| Type de produit | FPGA | |
| Nombre de cellules logiques | 3520 | |
| Nombre d'unités logiques | 440 | |
| Nombre de registres | 3520 | |
| Type de montage | Surface | |
| Type de Boitier | TQFP | |
| Tension d'alimentation minimum | 1.14V | |
| Tension d'alimentation maximum | 1.26V | |
| Nombre de broches | 144 | |
| Nombre de bits de RAM | 80000bit | |
| Température minimum de fonctionnement | -40°C | |
| Température d'utilisation maximum | 85°C | |
| Longueur | 20mm | |
| Hauteur | 1.45mm | |
| Normes/homologations | No | |
| Standard automobile | Non | |
| Sélectionner tout | ||
|---|---|---|
Marque Lattice Semiconductor | ||
Série iCE40 | ||
Type de produit FPGA | ||
Nombre de cellules logiques 3520 | ||
Nombre d'unités logiques 440 | ||
Nombre de registres 3520 | ||
Type de montage Surface | ||
Type de Boitier TQFP | ||
Tension d'alimentation minimum 1.14V | ||
Tension d'alimentation maximum 1.26V | ||
Nombre de broches 144 | ||
Nombre de bits de RAM 80000bit | ||
Température minimum de fonctionnement -40°C | ||
Température d'utilisation maximum 85°C | ||
Longueur 20mm | ||
Hauteur 1.45mm | ||
Normes/homologations No | ||
Standard automobile Non | ||
- Pays d'origine :
- KR
Réseaux de porte programmables sur le terrain Lattice Semiconductor
Un FPGA est un dispositif à semi-conducteurs composé d'une matrice de blocs logiques configurables (CLB) connectés par des interconnexions programmables. L'utilisateur détermine ces interconnexions en programmant la mémoire SRAM. Un CLB peut être simple (portes AND, OR, etc.) ou complexe (un bloc de RAM). Le FPGA permet d'apporter des modifications à une conception même après le soudage du dispositif sur un circuit imprimé.
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