SDRAM AEC-Q100 Intelligent Memory, 1 GB Surface 16 bit 95 °C -40 °C 60 broches, FBGA-60 billes
- Code commande RS:
- 588-633
- Référence fabricant:
- IME1G08D2DEBG-25I
- Marque:
- Intelligent Memory
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*Prix donné à titre indicatif
- Code commande RS:
- 588-633
- Référence fabricant:
- IME1G08D2DEBG-25I
- Marque:
- Intelligent Memory
Caractéristiques techniques
Documentation technique
Législation et Conformité
Détail produit
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Sélectionner tout | Attribut | Valeur |
|---|---|---|
| Marque | Intelligent Memory | |
| Taille de la mémoire | 1GB | |
| Type de produit | SDRAM | |
| Configuration | 128M x 8 | |
| Largeur de bus de données | 16bit | |
| Fréquence d'horloge maximum | 533MHz | |
| Nombre de bits par mot | 72 | |
| Temps d'accès aléatoire maximum | 2.5ns | |
| Nombre de mots | 16777216 | |
| Type de montage | Surface | |
| Type de Boitier | FBGA-60 billes | |
| Température minimum de fonctionnement | -40°C | |
| Nombre de broches | 60 | |
| Température d'utilisation maximum | 95°C | |
| Série | IME1G(08/16)D2DEB | |
| Normes/homologations | JEDEC, RoHS | |
| Tension d'alimentation minimum | 1.7V | |
| Tension d'alimentation maximum | 1.9V | |
| Standard automobile | AEC-Q100 | |
| Sélectionner tout | ||
|---|---|---|
Marque Intelligent Memory | ||
Taille de la mémoire 1GB | ||
Type de produit SDRAM | ||
Configuration 128M x 8 | ||
Largeur de bus de données 16bit | ||
Fréquence d'horloge maximum 533MHz | ||
Nombre de bits par mot 72 | ||
Temps d'accès aléatoire maximum 2.5ns | ||
Nombre de mots 16777216 | ||
Type de montage Surface | ||
Type de Boitier FBGA-60 billes | ||
Température minimum de fonctionnement -40°C | ||
Nombre de broches 60 | ||
Température d'utilisation maximum 95°C | ||
Série IME1G(08/16)D2DEB | ||
Normes/homologations JEDEC, RoHS | ||
Tension d'alimentation minimum 1.7V | ||
Tension d'alimentation maximum 1.9V | ||
Standard automobile AEC-Q100 | ||
- Pays d'origine :
- TW
La DRAM DDR Intelligent Memory à huit banques est organisée en 8 banques x 16 Mbit x 8 ou 8 banques x 8 Mbit x 16. Elle atteint des taux de transfert de données élevés en employant une architecture de puce qui pré-extrait plusieurs bits et synchronise les données de sortie avec l'horloge du système.
Commande de précharge automatique et contrôlée
Mode mise hors tension
Rafraîchissement automatique et auto-rafraîchissement
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