SDRAM Winbond, 2 Go Surface 16 bit 95 °C -40 °C 84 broches, WBGA
- Code commande RS:
- 188-2584
- Référence fabricant:
- W972GG6KB25I
- Marque:
- Winbond
Actuellement indisponible
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- Code commande RS:
- 188-2584
- Référence fabricant:
- W972GG6KB25I
- Marque:
- Winbond
Caractéristiques techniques
Documentation technique
Législation et Conformité
Détail produit
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Sélectionner tout | Attribut | Valeur |
|---|---|---|
| Marque | Winbond | |
| Taille de la mémoire | 2Go | |
| Type de produit | SDRAM | |
| Configuration | 256M x 8 bits | |
| Largeur de bus de données | 16bit | |
| Largeur de bus d'adresse | 17bit | |
| Nombre de bits par mot | 8 | |
| Fréquence d'horloge maximum | 533MHz | |
| Temps d'accès aléatoire maximum | 0.4ns | |
| Nombre de mots | 256M | |
| Type de montage | Surface | |
| Type de Boitier | WBGA | |
| Température minimum de fonctionnement | -40°C | |
| Nombre de broches | 84 | |
| Température d'utilisation maximum | 95°C | |
| Normes/homologations | RoHS | |
| Hauteur | 0.6mm | |
| Longueur | 12.6mm | |
| Série | W972GG6KB | |
| Largeur | 8.1mm | |
| Standard automobile | Non | |
| Courant d'alimentation | 280mA | |
| Tension d'alimentation maximum | 1.9V | |
| Tension d'alimentation minimum | 1.7V | |
| Sélectionner tout | ||
|---|---|---|
Marque Winbond | ||
Taille de la mémoire 2Go | ||
Type de produit SDRAM | ||
Configuration 256M x 8 bits | ||
Largeur de bus de données 16bit | ||
Largeur de bus d'adresse 17bit | ||
Nombre de bits par mot 8 | ||
Fréquence d'horloge maximum 533MHz | ||
Temps d'accès aléatoire maximum 0.4ns | ||
Nombre de mots 256M | ||
Type de montage Surface | ||
Type de Boitier WBGA | ||
Température minimum de fonctionnement -40°C | ||
Nombre de broches 84 | ||
Température d'utilisation maximum 95°C | ||
Normes/homologations RoHS | ||
Hauteur 0.6mm | ||
Longueur 12.6mm | ||
Série W972GG6KB | ||
Largeur 8.1mm | ||
Standard automobile Non | ||
Courant d'alimentation 280mA | ||
Tension d'alimentation maximum 1.9V | ||
Tension d'alimentation minimum 1.7V | ||
Le W972GG6KB est une SDRAM DDR2 de 2 bits, et la vitesse impliquant -18, -25/25I et -3/-3I.
Architecture à double vitesse de transmission : deux transferts de données par cycle d'horloge
Latence CAS : 3, 4, 5, 6 et 7
Longueur du train d'ondes : 4 et 8
Strobes de données différentielles bidirectionnels (DQS et /DQS) transmis ou reçus avec des données
Bord aligné avec lecture de données et centre aligné avec écriture de données
DLL aligne les transitions DQ et DQS avec l'horloge
Entrées d'horloge différentielle (CLK et /CLK)
Masques de données (DM) pour écriture de données
Les commandes entrées sur chaque bord CLK positif, les données et le masque de données sont référencées aux deux bords de /DQS
Latence additive programmable /CAS prise en charge pour rendre l'efficacité du bus de commande et de données
Latence de lecture = latence additive plus latence CAS (RL = AL + CL)
Réglage de l'impédance du pilote hors puce (OCD) et terminaison intégrée (ODT) pour une meilleure qualité de signal
Fonctionnement de la précharge automatique pour lire et écrire des trains d'ondes
Modes actualisation automatique et autoactualisation
Mise hors tension préchargée et mise hors tension active
Masque de données d'écriture
Latence d'écriture = latence de lecture - 1 (WL = RL - 1)
Interface : SSTL_18