SDRAM Winbond, 512 Mo En surface 16 bit 95 °C -40 °C 84 broches, VFBGA
- Code commande RS:
- 242-0780
- Référence fabricant:
- W9751G6NB25I
- Marque:
- Winbond
Informations sur le stock actuellement non accessibles
- Code commande RS:
- 242-0780
- Référence fabricant:
- W9751G6NB25I
- Marque:
- Winbond
Caractéristiques techniques
Documentation technique
Législation et Conformité
Détail produit
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Sélectionner tout | Attribut | Valeur |
|---|---|---|
| Marque | Winbond | |
| Type de produit | SDRAM | |
| Taille de la mémoire | 512Mo | |
| Largeur de bus de données | 16bit | |
| Largeur de bus d'adresse | 15bit | |
| Nombre de bits par mot | 16 | |
| Temps d'accès aléatoire maximum | 0.4ns | |
| Nombre de mots | 32M | |
| Type de montage | En surface | |
| Type de Boitier | VFBGA | |
| Nombre de broches | 84 | |
| Température minimum de fonctionnement | -40°C | |
| Température d'utilisation maximum | 95°C | |
| Longueur | 12.5mm | |
| Hauteur | 0.6mm | |
| Série | W9751G6NB | |
| Largeur | 8mm | |
| Normes/homologations | RoHS | |
| Standard automobile | Non | |
| Tension d'alimentation minimum | 1.7V | |
| Tension d'alimentation maximum | 1.9V | |
| Sélectionner tout | ||
|---|---|---|
Marque Winbond | ||
Type de produit SDRAM | ||
Taille de la mémoire 512Mo | ||
Largeur de bus de données 16bit | ||
Largeur de bus d'adresse 15bit | ||
Nombre de bits par mot 16 | ||
Temps d'accès aléatoire maximum 0.4ns | ||
Nombre de mots 32M | ||
Type de montage En surface | ||
Type de Boitier VFBGA | ||
Nombre de broches 84 | ||
Température minimum de fonctionnement -40°C | ||
Température d'utilisation maximum 95°C | ||
Longueur 12.5mm | ||
Hauteur 0.6mm | ||
Série W9751G6NB | ||
Largeur 8mm | ||
Normes/homologations RoHS | ||
Standard automobile Non | ||
Tension d'alimentation minimum 1.7V | ||
Tension d'alimentation maximum 1.9V | ||
La SDRAM Winbond est une SDRAM DDR2 de 512 Mbits qui est organisée en 8 388 608 mots, 4 banques, 16 bits. Ce dispositif atteint des vitesses de transfert élevées pour diverses applications.
Deux transferts de données par cycle d'horloge
Alignement sur le bord avec les données de lecture et alignement sur le centre avec les données d'écriture
DLL aligne les transitions DQ et DQS avec l'horloge